2.2 Integrované čítače
2.2.1 Čtyřbitové čítače:
|
|
||||||||||
Zapojení čítače do 10: |
Zapojení čítače do 6: |
||||||||||
|
Zapojení čítače do 24:
Zapojení čítače
do 36:
( MATES 0 - 35)
Pomocné hradlo
AND (2x NAND) používáme, potřebujeme-li na resetovací vstupy
vyvést více než dva výstupy z čítačů pro zkrácené čítání.
MH 7493
Čtyřbitový asynchronní binární čítač.
Skládá se ze čtyř klopných obvodů J -K rozdělených na čítač modulo dvě a modulo osm. Oba tyto čítače mají vlastní vstup hodinových impulsů a čítají na sestupnou hranu. Pokud propojíme výstup jednoho čítače ( Q0 ) a vstup druhého ( CP2 ) získáme tak čítač (dělič) modulo 16. Obvod je dále vybaven nulovacími vstupy pro všechny čtyři klopné obvody.
|
|
|
Dělič dvěma: |
Dělič třemi: |
Dělič čtyřmi: |
Dělič pěti: |
Dělič šesti: |
Dělič osmi: |
Dělič devíti: |
Dělič desíti: |
Dělič dvanácti: |
Dělič patnácti:: |
Dělič šestnácti: |
Čítač do 11 |
2.2.2 Vratné čítače:
MH 74192
Dekadický synchronní čítač vratný s předvolbou
Je složen ze čtyř klopných obvodů typu
"master- slave" a řídící logikou. Obvod má dva
vstupy. Samostatný vstup CPD
pro čítání nahoru a CPU
pro čítání dolů. Podle toho kam přivedeme hodinové
impulsy, bude IO čítat nahoru nebo dolů. Druhý nezapojený
vstup se nastaví na logickou H
. Oba vstupy reagují na náběžnou hranu hodinového impulsu.
Čítač dále umožňuje předvolbu čísel na výstupech, tzn.
nastavit předem zvolené číslo,(na vstupy předvolby A,
B, C, D) které se nám zobrazí na výstupu, přivedeme-li
na vstup Lnon logickou
úroveň H . Na zadání
čísel použijeme tabulku s BCD kódem.
Vstup nulování MR nám zajišťuje vyresetování
(tzn. nastavení všech výstupů do logické úrovně L), pokud
na něj přivedeme logickou úroveň H.
|
MH 74193
Binární synchronní čítač vratný s předvolbou
Funkce a funkční tabulka je stejná jako u MH74192